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@sebseb7

sebseb7/cpu.circ

Created May 11, 2022 21:20
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cpu.circ
<?xml version="1.0" encoding="UTF-8" standalone="no"?>
<project source="4.0.4-HC" version="1.0">
This file is intended to be loaded by Logisim-evolution (https://github.com/kevinawalsh/logisim-evolution).
<lib desc="#Wiring" name="0">
<tool name="Splitter">
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="facing" val="north"/>
<a name="fanout" val="1"/>
<a name="incoming" val="4"/>
</tool>
</lib>
<lib desc="#Gates" name="1">
<tool name="AND Gate">
<a name="size" val="30"/>
</tool>
<tool name="OR Gate">
<a name="size" val="30"/>
</tool>
<tool name="NAND Gate">
<a name="size" val="30"/>
</tool>
<tool name="NOR Gate">
<a name="size" val="30"/>
</tool>
<tool name="XOR Gate">
<a name="size" val="30"/>
</tool>
<tool name="XNOR Gate">
<a name="size" val="30"/>
</tool>
<tool name="PLA">
<a name="table" val=""/>
</tool>
</lib>
<lib desc="#Plexers" name="2">
<tool name="Multiplexer">
<a name="enable" val="false"/>
<a name="width" val="8"/>
</tool>
<tool name="Demultiplexer">
<a name="enable" val="false"/>
</tool>
</lib>
<lib desc="#Arithmetic" name="3"/>
<lib desc="#Memory" name="4">
<tool name="Register">
<a name="width" val="1"/>
</tool>
<tool name="ROM">
<a name="addrWidth" val="12"/>
<a name="contents">addr/data: 12 16
0
</a>
<a name="dataWidth" val="16"/>
</tool>
</lib>
<lib desc="#I/O" name="5"/>
<lib desc="#Base" name="6">
<tool name="Text Tool">
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="text" val=""/>
<a name="valign" val="base"/>
</tool>
</lib>
<lib desc="#Analog" name="7">
<tool name="Power">
<a name="facing" val="south"/>
</tool>
<tool name="Pull Resistor">
<a name="facing" val="north"/>
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<lib desc="#BFH-Praktika" name="8"/>
<main name="main"/>
<options>
<a name="gateUndefined" val="ignore"/>
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<a name="simrand" val="0"/>
</options>
<mappings>
<tool lib="6" map="Button2" name="Menu Tool"/>
<tool lib="6" map="Button3" name="Menu Tool"/>
<tool lib="6" map="Ctrl Button1" name="Menu Tool"/>
</mappings>
<toolbar>
<tool lib="6" name="Poke Tool"/>
<tool lib="6" name="Edit Tool"/>
<tool lib="6" name="Text Tool">
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="text" val=""/>
<a name="valign" val="base"/>
</tool>
<sep/>
<tool lib="0" name="Pin"/>
<tool lib="0" name="Pin">
<a name="facing" val="west"/>
<a name="labelloc" val="east"/>
<a name="type" val="output"/>
</tool>
<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
<tool lib="1" name="OR Gate"/>
</toolbar>
<circuit name="main">
<a name="appearance" val="classic"/>
<comp lib="0" loc="(100,330)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="ADDR_ABUS_IN"/>
</comp>
<comp lib="0" loc="(100,370)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="CLK"/>
</comp>
<comp lib="0" loc="(100,400)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RESET"/>
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<a name="label" val="ROM_OUT"/>
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<a name="label" val="W_BUS"/>
<a name="width" val="8"/>
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<a name="appear" val="right"/>
<a name="fanout" val="4"/>
<a name="incoming" val="4"/>
</comp>
<comp lib="0" loc="(1070,1490)" name="Splitter">
<a name="appear" val="right"/>
<a name="fanout" val="4"/>
<a name="incoming" val="4"/>
</comp>
<comp lib="0" loc="(1080,1470)" name="Splitter">
<a name="appear" val="right"/>
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="bit4" val="1"/>
<a name="bit5" val="1"/>
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<a name="incoming" val="8"/>
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<comp lib="0" loc="(1080,20)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="CLK"/>
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<a name="appear" val="right"/>
<a name="fanout" val="4"/>
<a name="incoming" val="4"/>
</comp>
<comp lib="0" loc="(1100,1250)" name="Splitter">
<a name="appear" val="right"/>
<a name="fanout" val="4"/>
<a name="incoming" val="4"/>
</comp>
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<a name="facing" val="east"/>
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<a name="width" val="3"/>
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<a name="facing" val="east"/>
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<a name="width" val="8"/>
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<a name="appear" val="right"/>
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="bit4" val="1"/>
<a name="bit5" val="1"/>
<a name="bit6" val="1"/>
<a name="bit7" val="1"/>
<a name="facing" val="south"/>
<a name="incoming" val="8"/>
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<comp lib="0" loc="(1120,1030)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="B_IN"/>
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<comp lib="0" loc="(1120,550)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="T_STATE"/>
<a name="width" val="3"/>
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<comp lib="0" loc="(1120,580)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="W_BUS"/>
<a name="width" val="8"/>
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<a name="facing" val="east"/>
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<a name="facing" val="east"/>
<a name="label" val="RESET"/>
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<a name="facing" val="east"/>
<a name="label" val="IR_REG"/>
<a name="width" val="8"/>
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<comp lib="0" loc="(1120,760)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="IR_IN"/>
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<comp lib="0" loc="(1120,810)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="A_BUS"/>
<a name="width" val="8"/>
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<comp lib="0" loc="(1120,840)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="A_OUT"/>
</comp>
<comp lib="0" loc="(1120,900)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="A_IN"/>
</comp>
<comp lib="0" loc="(1120,970)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="B_OUT"/>
</comp>
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<a name="label" val="ADDR_INL"/>
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<a name="label" val="PC_ABUS_OUT"/>
</comp>
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<a name="label" val="ADDR_ABUS_IN"/>
</comp>
<comp lib="0" loc="(1130,1570)" name="Tunnel">
<a name="label" val="ADDR_ABUS_OUT"/>
</comp>
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<a name="label" val="C_OUT"/>
</comp>
<comp lib="0" loc="(1140,1270)" name="Tunnel">
<a name="label" val="Z_OUT"/>
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<a name="label" val="S_OUT"/>
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<a name="label" val="FLAG_INV"/>
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<a name="label" val="ALU_STC"/>
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<a name="label" val="ALU_CLC"/>
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<a name="label" val="ALU_SUB"/>
</comp>
<comp lib="0" loc="(1140,1400)" name="Tunnel">
<a name="label" val="ROM_OUT"/>
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<comp lib="0" loc="(1150,20)" name="Tunnel">
<a name="label" val="RUN"/>
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<comp lib="0" loc="(120,460)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="W_BUS"/>
<a name="width" val="8"/>
</comp>
<comp lib="0" loc="(120,620)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="W_BUS"/>
<a name="width" val="8"/>
</comp>
<comp lib="0" loc="(1210,1140)" name="Splitter">
<a name="appear" val="center"/>
<a name="bit1" val="0"/>
<a name="bit10" val="1"/>
<a name="bit2" val="0"/>
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<a name="bit5" val="1"/>
<a name="bit6" val="1"/>
<a name="bit7" val="1"/>
<a name="bit8" val="1"/>
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<a name="fanout" val="4"/>
<a name="incoming" val="4"/>
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<comp lib="0" loc="(1240,1250)" name="Splitter">
<a name="appear" val="right"/>
<a name="fanout" val="4"/>
<a name="incoming" val="4"/>
</comp>
<comp lib="0" loc="(1250,1220)" name="Splitter">
<a name="appear" val="right"/>
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="bit4" val="1"/>
<a name="bit5" val="1"/>
<a name="bit6" val="1"/>
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<a name="label" val="A_OUT"/>
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<a name="label" val="A_IN"/>
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<a name="label" val="B_OUT"/>
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<a name="label" val="B_IN"/>
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<comp lib="0" loc="(1280,1340)" name="Tunnel">
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<a name="label" val="ALU_IN"/>
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<a name="label" val="T_RESET"/>
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<a name="facing" val="east"/>
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<a name="fanout" val="8"/>
<a name="incoming" val="8"/>
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<a name="incoming" val="8"/>
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<a name="facing" val="north"/>
<a name="fanout" val="8"/>
<a name="incoming" val="8"/>
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<a name="incoming" val="4"/>
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<a name="fanout" val="4"/>
<a name="incoming" val="4"/>
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<a name="incoming" val="8"/>
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<a name="incoming" val="16"/>
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<a name="label" val="ADDR_INH"/>
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<comp lib="0" loc="(1420,1380)" name="Tunnel">
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<a name="label" val="IR_IN"/>
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<comp lib="0" loc="(1570,1010)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="ALU_STC"/>
</comp>
<comp lib="0" loc="(1570,1040)" name="Tunnel">
<a name="facing" val="east"/>
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<comp lib="0" loc="(1570,1110)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="ALU_IN"/>
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<comp lib="0" loc="(1570,1140)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="ALU_SUB"/>
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<comp lib="0" loc="(1570,1180)" name="Tunnel">
<a name="facing" val="east"/>
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<a name="width" val="8"/>
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<a name="facing" val="east"/>
<a name="label" val="C"/>
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<comp lib="0" loc="(1570,1250)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="C_OUT"/>
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<comp lib="0" loc="(1570,450)" name="Tunnel">
<a name="facing" val="east"/>
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<a name="facing" val="east"/>
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<comp lib="0" loc="(1570,490)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RAM_OUT"/>
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<comp lib="0" loc="(1570,510)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="HALT"/>
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<comp lib="0" loc="(1570,600)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="W_BUS"/>
<a name="width" val="8"/>
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<comp lib="0" loc="(1570,630)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="DISP_IN"/>
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<comp lib="0" loc="(1570,660)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="MODE"/>
<a name="width" val="2"/>
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<comp lib="0" loc="(1570,690)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="CLK"/>
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<comp lib="0" loc="(1570,720)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RESET"/>
</comp>
<comp lib="0" loc="(1570,860)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="ALU_OUT"/>
</comp>
<comp lib="0" loc="(1570,980)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="ALU_C"/>
</comp>
<comp lib="0" loc="(160,520)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit10" val="1"/>
<a name="bit11" val="1"/>
<a name="bit12" val="1"/>
<a name="bit13" val="1"/>
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<a name="bit15" val="1"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="bit4" val="0"/>
<a name="bit5" val="0"/>
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<a name="facing" val="north"/>
<a name="incoming" val="16"/>
</comp>
<comp lib="0" loc="(160,650)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit10" val="1"/>
<a name="bit11" val="1"/>
<a name="bit12" val="1"/>
<a name="bit13" val="1"/>
<a name="bit14" val="1"/>
<a name="bit15" val="1"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="bit4" val="0"/>
<a name="bit5" val="0"/>
<a name="bit6" val="0"/>
<a name="bit7" val="0"/>
<a name="bit8" val="1"/>
<a name="bit9" val="1"/>
<a name="facing" val="north"/>
<a name="incoming" val="16"/>
</comp>
<comp lib="0" loc="(1640,450)" name="Tunnel">
<a name="label" val="PC_IN"/>
</comp>
<comp lib="0" loc="(1640,470)" name="Tunnel">
<a name="label" val="ADDR_IN"/>
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<comp lib="0" loc="(1640,490)" name="Tunnel">
<a name="label" val="RAM_IN"/>
</comp>
<comp lib="0" loc="(1640,510)" name="Tunnel">
<a name="label" val="IR_IN"/>
<a name="labelfont" val="Dialog plain 12"/>
</comp>
<comp lib="0" loc="(1750,640)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="bit4" val="0"/>
<a name="bit5" val="0"/>
<a name="bit6" val="0"/>
<a name="bit7" val="0"/>
<a name="bit8" val="1"/>
<a name="bit9" val="1"/>
<a name="facing" val="west"/>
<a name="incoming" val="10"/>
</comp>
<comp lib="0" loc="(1780,1180)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="bit4" val="0"/>
<a name="bit5" val="0"/>
<a name="bit6" val="0"/>
<a name="bit7" val="0"/>
<a name="bit8" val="1"/>
<a name="facing" val="west"/>
<a name="incoming" val="9"/>
</comp>
<comp lib="0" loc="(1780,1260)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
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<a name="size" val="30"/>
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<comp lib="1" loc="(1670,1230)" name="AND Gate">
<a name="size" val="30"/>
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<comp lib="1" loc="(1680,850)" name="Controlled Buffer">
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<comp lib="1" loc="(1730,1010)" name="OR Gate">
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<a name="size" val="30"/>
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<comp lib="1" loc="(180,520)" name="Controlled Buffer">
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</comp>
<comp lib="1" loc="(180,650)" name="Controlled Buffer">
<a name="width" val="16"/>
</comp>
<comp lib="1" loc="(1820,1100)" name="Controlled Buffer">
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<comp lib="1" loc="(1920,1220)" name="NOR Gate">
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<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(260,270)" name="Controlled Buffer">
<a name="width" val="16"/>
</comp>
<comp lib="1" loc="(660,480)" name="Controlled Buffer">
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<a name="width" val="8"/>
</comp>
<comp lib="1" loc="(700,280)" name="Controlled Buffer">
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</comp>
<comp lib="1" loc="(740,1170)" name="NOR Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(740,1240)" name="XOR Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(740,1300)" name="XOR Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(740,1360)" name="XOR Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(780,940)" name="NOT Gate">
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</comp>
<comp lib="1" loc="(790,1230)" name="AND Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(790,1290)" name="AND Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(790,1350)" name="AND Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(850,1060)" name="AND Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(850,900)" name="Controlled Buffer">
<a name="control" val="left"/>
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<a name="width" val="8"/>
</comp>
<comp lib="1" loc="(850,990)" name="AND Gate">
<a name="negate1" val="true"/>
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(860,1160)" name="AND Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(860,1220)" name="AND Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(860,1280)" name="AND Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(860,1340)" name="AND Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(870,870)" name="Controlled Buffer">
<a name="control" val="left"/>
<a name="width" val="8"/>
</comp>
<comp lib="1" loc="(900,1020)" name="OR Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(940,1030)" name="AND Gate">
<a name="negate1" val="true"/>
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(940,1180)" name="OR Gate">
<a name="inputs" val="4"/>
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(990,1760)" name="Controlled Buffer">
<a name="control" val="left"/>
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</comp>
<comp lib="2" loc="(1310,580)" name="Decoder">
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<a name="select" val="3"/>
</comp>
<comp lib="2" loc="(1850,1180)" name="Multiplexer">
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<a name="width" val="9"/>
</comp>
<comp lib="2" loc="(2010,620)" name="Decoder">
<a name="select" val="2"/>
</comp>
<comp lib="3" loc="(1750,1190)" name="Adder"/>
<comp lib="3" loc="(1750,1270)" name="Subtractor"/>
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<a name="max" val="0x7"/>
<a name="width" val="3"/>
</comp>
<comp lib="4" loc="(1230,750)" name="Register"/>
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<a name="addrWidth" val="11"/>
<a name="contents">addr/data: 11 32
0
</a>
<a name="dataWidth" val="32"/>
</comp>
<comp lib="4" loc="(150,300)" name="Register">
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</comp>
<comp lib="4" loc="(1650,590)" name="Counter">
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<a name="width" val="2"/>
</comp>
<comp lib="4" loc="(1700,620)" name="Register"/>
<comp lib="4" loc="(1710,900)" name="Register"/>
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