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| A[32] B[32] Shift[5] CarryIn[1] Codop[4] S[32] Flags[4] | |
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| # A B Shift CarryIn Codop S Flags | |
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| 1 1110011111111111 1 1 0 1 11111111111 1 | |
| 1 1110011111111111 1 1 1 0 11111111111 1 | |
| 1 1110011111111111 1 1 1 1 11111111111 1 | |
| # Conditional | |
| # 0000, EQ, Z == 1 | |
| 1 1101000011111111 0 0 0 0 xxxxxxxxxxx 0 | |
| 1 1101000011111111 0 0 0 1 xxxxxxxxxxx 0 | |
| 1 1101000011111111 0 0 1 0 xxxxxxxxxxx 0 | |
| 1 1101000011111111 0 0 1 1 xxxxxxxxxxx 0 | |
| 1 1101000011111111 0 1 0 0 11111111111 1 | |
| 1 1101000011111111 0 1 0 1 11111111111 1 | |
| 1 1101000011111111 0 1 1 0 11111111111 1 | |
| 1 1101000011111111 0 1 1 1 11111111111 1 | |
| 1 1101000011111111 1 0 0 0 xxxxxxxxxxx 0 | |
| 1 1101000011111111 1 0 0 1 xxxxxxxxxxx 0 | |
| 1 1101000011111111 1 0 1 0 xxxxxxxxxxx 0 | |
| 1 1101000011111111 1 0 1 1 xxxxxxxxxxx 0 | |
| 1 1101000011111111 1 1 0 0 11111111111 1 | |
| 1 1101000011111111 1 1 0 1 11111111111 1 | |
| 1 1101000011111111 1 1 1 0 11111111111 1 | |
| 1 1101000011111111 1 1 1 1 11111111111 1 | |
| 0 1101000011111111 0 0 0 0 00000000000 0 | |
| 0 1101000011111111 0 0 0 1 00000000000 0 | |
| 0 1101000011111111 0 0 1 0 00000000000 0 | |
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| 0 1101000011111111 0 1 0 1 00000000000 0 | |
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| 0 1101000011111111 0 1 1 1 00000000000 0 | |
| 0 1101000011111111 1 0 0 0 00000000000 0 | |
| 0 1101000011111111 1 0 0 1 00000000000 0 | |
| 0 1101000011111111 1 0 1 0 00000000000 0 | |
| 0 1101000011111111 1 0 1 1 00000000000 0 | |
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| 0 1101000011111111 1 1 1 0 00000000000 0 | |
| 0 1101000011111111 1 1 1 1 00000000000 0 | |
| # 0001, NE, Z == 0 | |
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| 1 1101000111111111 0 0 0 1 11111111111 1 | |
| 1 1101000111111111 0 0 1 0 11111111111 1 | |
| 1 1101000111111111 0 0 1 1 11111111111 1 | |
| 1 1101000111111111 0 1 0 0 xxxxxxxxxxx 0 | |
| 1 1101000111111111 0 1 0 1 xxxxxxxxxxx 0 | |
| 1 1101000111111111 0 1 1 0 xxxxxxxxxxx 0 | |
| 1 1101000111111111 0 1 1 1 xxxxxxxxxxx 0 | |
| 1 1101000111111111 1 0 0 0 11111111111 1 | |
| 1 1101000111111111 1 0 0 1 11111111111 1 | |
| 1 1101000111111111 1 0 1 0 11111111111 1 | |
| 1 1101000111111111 1 0 1 1 11111111111 1 | |
| 1 1101000111111111 1 1 0 0 xxxxxxxxxxx 0 | |
| 1 1101000111111111 1 1 0 1 xxxxxxxxxxx 0 | |
| 1 1101000111111111 1 1 1 0 xxxxxxxxxxx 0 | |
| 1 1101000111111111 1 1 1 1 xxxxxxxxxxx 0 | |
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| 0 1101000111111111 0 0 0 1 00000000000 0 | |
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| 0 1101000111111111 1 1 1 1 00000000000 0 | |
| # 0010 CS ou HS, C == 1 | |
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| 1 1101001011111111 0 0 0 1 xxxxxxxxxxx 0 | |
| 1 1101001011111111 0 0 1 0 11111111111 1 | |
| 1 1101001011111111 0 0 1 1 11111111111 1 | |
| 1 1101001011111111 0 1 0 0 xxxxxxxxxxx 0 | |
| 1 1101001011111111 0 1 0 1 xxxxxxxxxxx 0 | |
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| 1 1101001011111111 0 1 1 1 11111111111 1 | |
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| 1 1101001011111111 1 0 0 1 xxxxxxxxxxx 0 | |
| 1 1101001011111111 1 0 1 0 11111111111 1 | |
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| 1 1101001011111111 1 1 0 1 xxxxxxxxxxx 0 | |
| 1 1101001011111111 1 1 1 0 11111111111 1 | |
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| 0 1101001011111111 1 0 0 1 00000000000 0 | |
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| 0 1101001011111111 1 1 1 1 00000000000 0 | |
| # 0011, CC ou LO, C == 0 | |
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| 1 1101001111111111 0 0 0 1 11111111111 1 | |
| 1 1101001111111111 0 0 1 0 xxxxxxxxxxx 0 | |
| 1 1101001111111111 0 0 1 1 xxxxxxxxxxx 0 | |
| 1 1101001111111111 0 1 0 0 11111111111 1 | |
| 1 1101001111111111 0 1 0 1 11111111111 1 | |
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| 1 1101001111111111 1 0 0 1 11111111111 1 | |
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| 1 1101001111111111 1 1 0 1 11111111111 1 | |
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| # 0100, MI, N == 1 | |
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| # 0101, PL, N == 0 | |
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| 1 1101010111111111 0 0 1 1 11111111111 1 | |
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| 1 1101010111111111 0 1 1 0 11111111111 1 | |
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| 0 1101010111111111 1 1 1 1 00000000000 0 | |
| # 0110, VS, V == 1 | |
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| # 0111, VC, V == 0 | |
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| 0 1101011111111111 1 1 1 1 00000000000 0 | |
| # 1000, HI, C == 1 et Z == 0 | |
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| 1 1101100011111111 0 0 0 1 xxxxxxxxxxx 0 | |
| 1 1101100011111111 0 0 1 0 11111111111 1 | |
| 1 1101100011111111 0 0 1 1 11111111111 1 | |
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| 0 1101100011111111 1 1 1 1 00000000000 0 | |
| # 1001, LS, C == 0 ou Z == 1 | |
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| 1 1101100111111111 0 0 0 1 11111111111 1 | |
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| 0 1101100111111111 1 1 1 1 00000000000 0 | |
| # 1010, GE, N == V | |
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| # 1011, LT, N != V | |
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| 1 1101101111111111 0 0 0 1 11111111111 1 | |
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| 1 1101101111111111 0 1 1 1 11111111111 1 | |
| 1 1101101111111111 1 0 0 0 11111111111 1 | |
| 1 1101101111111111 1 0 0 1 xxxxxxxxxxx 0 | |
| 1 1101101111111111 1 0 1 0 11111111111 1 | |
| 1 1101101111111111 1 0 1 1 xxxxxxxxxxx 0 | |
| 1 1101101111111111 1 1 0 0 11111111111 1 | |
| 1 1101101111111111 1 1 0 1 xxxxxxxxxxx 0 | |
| 1 1101101111111111 1 1 1 0 11111111111 1 | |
| 1 1101101111111111 1 1 1 1 xxxxxxxxxxx 0 | |
| 0 1101101111111111 0 0 0 0 00000000000 0 | |
| 0 1101101111111111 0 0 0 1 00000000000 0 | |
| 0 1101101111111111 0 0 1 0 00000000000 0 | |
| 0 1101101111111111 0 0 1 1 00000000000 0 | |
| 0 1101101111111111 0 1 0 0 00000000000 0 | |
| 0 1101101111111111 0 1 0 1 00000000000 0 | |
| 0 1101101111111111 0 1 1 0 00000000000 0 | |
| 0 1101101111111111 0 1 1 1 00000000000 0 | |
| 0 1101101111111111 1 0 0 0 00000000000 0 | |
| 0 1101101111111111 1 0 0 1 00000000000 0 | |
| 0 1101101111111111 1 0 1 0 00000000000 0 | |
| 0 1101101111111111 1 0 1 1 00000000000 0 | |
| 0 1101101111111111 1 1 0 0 00000000000 0 | |
| 0 1101101111111111 1 1 0 1 00000000000 0 | |
| 0 1101101111111111 1 1 1 0 00000000000 0 | |
| 0 1101101111111111 1 1 1 1 00000000000 0 | |
| # 1100, GT, Z == 0 et N == V | |
| 1 1101110011111111 0 0 0 0 11111111111 1 | |
| 1 1101110011111111 0 0 0 1 xxxxxxxxxxx 0 | |
| 1 1101110011111111 0 0 1 0 11111111111 1 | |
| 1 1101110011111111 0 0 1 1 xxxxxxxxxxx 0 | |
| 1 1101110011111111 0 1 0 0 xxxxxxxxxxx 0 | |
| 1 1101110011111111 0 1 0 1 xxxxxxxxxxx 0 | |
| 1 1101110011111111 0 1 1 0 xxxxxxxxxxx 0 | |
| 1 1101110011111111 0 1 1 1 xxxxxxxxxxx 0 | |
| 1 1101110011111111 1 0 0 0 xxxxxxxxxxx 0 | |
| 1 1101110011111111 1 0 0 1 11111111111 1 | |
| 1 1101110011111111 1 0 1 0 xxxxxxxxxxx 0 | |
| 1 1101110011111111 1 0 1 1 11111111111 1 | |
| 1 1101110011111111 1 1 0 0 xxxxxxxxxxx 0 | |
| 1 1101110011111111 1 1 0 1 xxxxxxxxxxx 0 | |
| 1 1101110011111111 1 1 1 0 xxxxxxxxxxx 0 | |
| 1 1101110011111111 1 1 1 1 xxxxxxxxxxx 0 | |
| 0 1101110011111111 0 0 0 0 00000000000 0 | |
| 0 1101110011111111 0 0 0 1 00000000000 0 | |
| 0 1101110011111111 0 0 1 0 00000000000 0 | |
| 0 1101110011111111 0 0 1 1 00000000000 0 | |
| 0 1101110011111111 0 1 0 0 00000000000 0 | |
| 0 1101110011111111 0 1 0 1 00000000000 0 | |
| 0 1101110011111111 0 1 1 0 00000000000 0 | |
| 0 1101110011111111 0 1 1 1 00000000000 0 | |
| 0 1101110011111111 1 0 0 0 00000000000 0 | |
| 0 1101110011111111 1 0 0 1 00000000000 0 | |
| 0 1101110011111111 1 0 1 0 00000000000 0 | |
| 0 1101110011111111 1 0 1 1 00000000000 0 | |
| 0 1101110011111111 1 1 0 0 00000000000 0 | |
| 0 1101110011111111 1 1 0 1 00000000000 0 | |
| 0 1101110011111111 1 1 1 0 00000000000 0 | |
| 0 1101110011111111 1 1 1 1 00000000000 0 | |
| # 1101, GT, Z == 1 ou N != V | |
| 1 1101110111111111 0 0 0 0 xxxxxxxxxxx 0 | |
| 1 1101110111111111 0 0 0 1 11111111111 1 | |
| 1 1101110111111111 0 0 1 0 xxxxxxxxxxx 0 | |
| 1 1101110111111111 0 0 1 1 11111111111 1 | |
| 1 1101110111111111 0 1 0 0 11111111111 1 | |
| 1 1101110111111111 0 1 0 1 11111111111 1 | |
| 1 1101110111111111 0 1 1 0 11111111111 1 | |
| 1 1101110111111111 0 1 1 1 11111111111 1 | |
| 1 1101110111111111 1 0 0 0 11111111111 1 | |
| 1 1101110111111111 1 0 0 1 xxxxxxxxxxx 0 | |
| 1 1101110111111111 1 0 1 0 11111111111 1 | |
| 1 1101110111111111 1 0 1 1 xxxxxxxxxxx 0 | |
| 1 1101110111111111 1 1 0 0 11111111111 1 | |
| 1 1101110111111111 1 1 0 1 11111111111 1 | |
| 1 1101110111111111 1 1 1 0 11111111111 1 | |
| 1 1101110111111111 1 1 1 1 11111111111 1 | |
| 0 1101110111111111 0 0 0 0 00000000000 0 | |
| 0 1101110111111111 0 0 0 1 00000000000 0 | |
| 0 1101110111111111 0 0 1 0 00000000000 0 | |
| 0 1101110111111111 0 0 1 1 00000000000 0 | |
| 0 1101110111111111 0 1 0 0 00000000000 0 | |
| 0 1101110111111111 0 1 0 1 00000000000 0 | |
| 0 1101110111111111 0 1 1 0 00000000000 0 | |
| 0 1101110111111111 0 1 1 1 00000000000 0 | |
| 0 1101110111111111 1 0 0 0 00000000000 0 | |
| 0 1101110111111111 1 0 0 1 00000000000 0 | |
| 0 1101110111111111 1 0 1 0 00000000000 0 | |
| 0 1101110111111111 1 0 1 1 00000000000 0 | |
| 0 1101110111111111 1 1 0 0 00000000000 0 | |
| 0 1101110111111111 1 1 0 1 00000000000 0 | |
| 0 1101110111111111 1 1 1 0 00000000000 0 | |
| 0 1101110111111111 1 1 1 1 00000000000 0 | |
| # 1110, AL | |
| 1 1101111011111111 0 0 0 0 11111111111 1 | |
| 1 1101111011111111 0 0 0 1 11111111111 1 | |
| 1 1101111011111111 0 0 1 0 11111111111 1 | |
| 1 1101111011111111 0 0 1 1 11111111111 1 | |
| 1 1101111011111111 0 1 0 0 11111111111 1 | |
| 1 1101111011111111 0 1 0 1 11111111111 1 | |
| 1 1101111011111111 0 1 1 0 11111111111 1 | |
| 1 1101111011111111 0 1 1 1 11111111111 1 | |
| 1 1101111011111111 1 0 0 0 11111111111 1 | |
| 1 1101111011111111 1 0 0 1 11111111111 1 | |
| 1 1101111011111111 1 0 1 0 11111111111 1 | |
| 1 1101111011111111 1 0 1 1 11111111111 1 | |
| 1 1101111011111111 1 1 0 0 11111111111 1 | |
| 1 1101111011111111 1 1 0 1 11111111111 1 | |
| 1 1101111011111111 1 1 1 0 11111111111 1 | |
| 1 1101111011111111 1 1 1 1 11111111111 1 | |
| 0 1101111011111111 0 0 0 0 00000000000 0 | |
| 0 1101111011111111 0 0 0 1 00000000000 0 | |
| 0 1101111011111111 0 0 1 0 00000000000 0 | |
| 0 1101111011111111 0 0 1 1 00000000000 0 | |
| 0 1101111011111111 0 1 0 0 00000000000 0 | |
| 0 1101111011111111 0 1 0 1 00000000000 0 | |
| 0 1101111011111111 0 1 1 0 00000000000 0 | |
| 0 1101111011111111 0 1 1 1 00000000000 0 | |
| 0 1101111011111111 1 0 0 0 00000000000 0 | |
| 0 1101111011111111 1 0 0 1 00000000000 0 | |
| 0 1101111011111111 1 0 1 0 00000000000 0 | |
| 0 1101111011111111 1 0 1 1 00000000000 0 | |
| 0 1101111011111111 1 1 0 0 00000000000 0 | |
| 0 1101111011111111 1 1 0 1 00000000000 0 | |
| 0 1101111011111111 1 1 1 0 00000000000 0 | |
| 0 1101111011111111 1 1 1 1 00000000000 0 |
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| Instruction[16] Enable[1] ALU_Opcode[4] Rm[3] Rn[3] Rd[3] Flags_Update_Mask[4] | |
| # NZCV | |
| # Instruction Enable ALU_Opcode Rm Rn Rd Flags_Update_Mask | |
| 0100000000101111 0 0000 000 000 000 0000 | |
| 1111111111111111 0 0000 000 000 000 0000 | |
| # 9.1.2.1 AND (register) : Bitwise AND (p. 201) | |
| 0100000000101111 1 0000 101 111 111 1110 | |
| 0100000000101111 0 0000 000 000 000 0000 | |
| # 9.1.2.2 EOR (register) : Exclusive OR (p. 233) | |
| 0100000001101111 1 0001 101 111 111 1110 | |
| 0100000001101111 0 0000 000 000 000 0000 | |
| # 9.1.2.3 LSL (register) : Logical Shift Left (p. 283) | |
| 0100000010101111 1 0010 101 111 111 1110 | |
| 0100000010101111 0 0000 000 000 000 0000 | |
| # 9.1.2.4 LSR (register) : Logical Shift Right (p. 285) | |
| 0100000011101111 1 0011 101 111 111 1110 | |
| 0100000011101111 0 0000 000 000 000 0000 | |
| # 9.1.2.5 ASR (register) : Arithmetic Shift Right (p. 204) | |
| 0100000100101111 1 0100 101 111 111 1110 | |
| 0100000100101111 0 0000 000 000 000 0000 | |
| # 9.1.2.6 ADC (register) : Add with Carry (p. 188) | |
| 0100000101101111 1 0101 101 111 111 1111 | |
| 0100000101101111 0 0000 000 000 000 0000 | |
| # 9.1.2.7 SBC (register) : Substract with Carry (p. 347) | |
| 0100000110101111 1 0110 101 111 111 1111 | |
| 0100000110101111 0 0000 000 000 000 0000 | |
| # 9.1.2.8 ROR (register) : Rotate Right (p. 339) | |
| 0100000111101111 1 0111 101 111 111 1110 | |
| 0100000111101111 0 0000 000 000 000 0000 | |
| # 9.1.2.9 TST (register) : Set flags on bitwise AND (p. 420) | |
| 0100001000101111 1 1000 101 111 111 1110 | |
| 0100001000101111 0 0000 000 000 000 0000 | |
| # 9.1.2.10 RSB (immediate) : Reverse Substract from 0 (p. 341) | |
| 0100001001101111 1 1001 xxx 101 111 1111 | |
| 0100001001101111 0 0000 000 000 000 0000 | |
| # 9.1.2.11 CMP (register) : Compare Registers (p. 224) | |
| 0100001010101111 1 1010 101 111 111 1111 | |
| 0100001010101111 0 0000 000 000 000 0000 | |
| # 9.1.2.12 CMN (register) : Compare Negative (p. 222) | |
| 0100001011101111 1 1011 101 111 111 1111 | |
| 0100001011101111 0 0000 000 000 000 0000 | |
| # 9.1.2.13 ORR (register) : Logical OR (p. 310) | |
| 0100001100101111 1 1100 101 111 111 1110 | |
| 0100001100101111 0 0000 000 000 000 0000 | |
| # 9.1.2.14 MUL : Multiply Two Registers (p. 302) | |
| 0100001101101111 1 1101 111 101 111 1100 | |
| 0100001101101111 0 0000 000 000 000 0000 | |
| # 9.1.2.15 BIC (register) : Bit Clear (p. 210) | |
| 0100001110101111 1 1110 101 111 111 1110 | |
| 0100001110101111 0 0000 000 000 000 0000 | |
| # 9.1.2.16 MVN (register) : Bitwise NOT (p. 304) | |
| 0100001111101111 1 1111 101 xxx 111 1110 | |
| 0100001111101111 0 0000 000 000 000 0000 |
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| Opcode[6] Shift[1] Data_Processing[1] Load_Store[1] SP_Address[1] Conditional[1] | |
| 000000 1 0 0 0 0 | |
| 000001 1 0 0 0 0 | |
| 000010 1 0 0 0 0 | |
| 000011 1 0 0 0 0 | |
| 000100 1 0 0 0 0 | |
| 000101 1 0 0 0 0 | |
| 000110 1 0 0 0 0 | |
| 000111 1 0 0 0 0 | |
| 001000 1 0 0 0 0 | |
| 001001 1 0 0 0 0 | |
| 001010 1 0 0 0 0 | |
| 001011 1 0 0 0 0 | |
| 001100 1 0 0 0 0 | |
| 001101 1 0 0 0 0 | |
| 001110 1 0 0 0 0 | |
| 001111 1 0 0 0 0 | |
| 010000 0 1 0 0 0 | |
| 100100 0 0 1 0 0 | |
| 100101 0 0 1 0 0 | |
| 100110 0 0 1 0 0 | |
| 100111 0 0 1 0 0 | |
| 101100 0 0 0 1 0 | |
| 101101 0 0 0 1 0 | |
| 101110 0 0 0 1 0 | |
| 101111 0 0 0 1 0 | |
| 110100 0 0 0 0 1 | |
| 110101 0 0 0 0 1 | |
| 110110 0 0 0 0 1 | |
| 110111 0 0 0 0 1 |
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| Instruction[16] Enable[1] Carry[1] Imm32_Enable[1] Imm5[5] Imm32[32] ALU_Opcode[4] Rm[3] Rn[3] Rd[3] Flags_Update_Mask[4] | |
| # instruction e c i Imm5 Imm32 Alu_ Rm Rn Rd flag | |
| 1111111111111111 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.1 LSL (immediate) : Logical Shift Left | |
| # LSLS Rd, Rm, #Imm5 | |
| # LSLS R5, R7, #11111 | |
| # 000 00 imm5 Rm Rd | |
| # 000 00 11111 111 101 | |
| 0000011111111101 1 0 0 11111 xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx 0010 111 111 101 1110 | |
| 0000011111111101 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.2 LSR (immediate) : Logical Shift Right | |
| # LSRS Rd, Rm, #Imm5 | |
| # LSRS R5, R7, #11111 | |
| # 000 01 Imm5 Rm Rd | |
| # 000 01 11111 111 101 | |
| 0000111111111101 1 0 0 11111 xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx 0011 111 111 101 1110 | |
| 0000111111111101 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.3 ASR : Arithmetic Shift Right | |
| # ASRS Rd, Rm, #Imm5 | |
| # ASRS R5, R7, #11111 | |
| # 000 10 Imm5 Rm Rd | |
| # 000 10 11111 111 101 | |
| 0001011111111101 1 0 0 11111 xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx 0100 111 111 101 1110 | |
| 0001011111111101 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.4 ADD : Add register | |
| # ADDS Rd, Rn, Rm | |
| # ADDS R5, R7, R3 | |
| # 000 11 0 0 Rm Rn Rd | |
| # 000 11 0 0 011 111 101 | |
| 0001100011111101 1 0 0 xxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx 0101 011 111 101 1111 | |
| 0001100011111101 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.5 SUB (register) : Substract register | |
| # SUBS Rd, Rn, Rm | |
| # SUBS R5, R7, R3 | |
| # 000 11 0 1 Rm Rn Rd | |
| # 000 11 0 1 011 111 101 | |
| 0001101011111101 1 1 0 xxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx 0110 011 111 101 1111 | |
| 0001101011111101 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.6 ADD (immediate) : Add 3-bit immediate | |
| # ADDS Rd, Rn, #Imm3 | |
| # ADDS R5, R7, #011 | |
| # 000 11 1 0 Imm3 Rn Rd | |
| # 000 11 1 0 011 111 101 | |
| 0001110011111101 1 0 1 xxxxx 00000000000000000000000000000011 0101 xxx 111 101 1111 | |
| 0001110011111101 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # ADDS R5, R7, #011 | |
| # 000 11 1 0 111 111 101 | |
| 0001110111111101 1 0 1 xxxxx 00000000000000000000000000000111 0101 xxx 111 101 1111 | |
| 0001110111111101 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.7 SUB (immediate) : Sub 3-bit immediate | |
| # SUBS Rd, Rn, #Imm3 | |
| # SUBS R5, R7, #011 | |
| # 000 11 1 1 Imm3 Rn Rd | |
| # 000 11 1 1 011 111 101 | |
| 0001111011111101 1 1 1 xxxxx 00000000000000000000000000000011 0110 xxx 111 101 1111 | |
| 0001111011111101 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # SUBS R5, R7, #011 | |
| # 000 11 1 1 111 111 101 | |
| 0001111111111101 1 1 1 xxxxx 00000000000000000000000000000111 0110 xxx 111 101 1111 | |
| 0001111111111101 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.8 MOV (immediate) : Move | |
| # MOVS Rd, #Imm8 | |
| # MOVS R5, 0111111 | |
| # 001 00 Rd Imm8 | |
| # 001 00 101 01111111 | |
| 0010010101111111 1 0 1 xxxxx 11111111111111111111111110000001 1001 xxx xxx 101 1100 | |
| 0010010101111111 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # MOVS R5, 1111111 | |
| # 001 00 101 11111111 | |
| 0010010111111111 1 0 1 xxxxx 11111111111111111111111100000001 1001 xxx xxx 101 1100 | |
| 0010010111111111 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.9 CMP (immediate) : Compare | |
| # CMP Rd, #Imm8 | |
| # CMP R5, 01111111 | |
| # 001 01 Rd Imm8 | |
| # 001 01 101 01111111 | |
| 0010110101111111 1 0 1 xxxxx 00000000000000000000000001111111 1010 xxx xxx 101 1111 | |
| 0010110101111111 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # CMP R5, 11111111 | |
| # 001 01 101 11111111 | |
| 0010110111111111 1 0 1 xxxxx 00000000000000000000000011111111 1010 xxx xxx 101 1111 | |
| 0010110111111111 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.10 ADD (immediate) : Add 8-bit immediate | |
| # ADDS Rdn, Rdn, #Imm8 | |
| # ADDS R5, #01111111 | |
| # 001 10 Rd Imm8 | |
| # 001 10 101 01111111 | |
| 0011010101111111 1 0 1 xxxxx 00000000000000000000000001111111 0101 xxx 101 101 1111 | |
| 0011010101111111 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # ADDS R5, #01111111 | |
| # 001 10 Rd Imm8 | |
| # 001 10 101 11111111 | |
| 0011010111111111 1 0 1 xxxxx 00000000000000000000000011111111 0101 xxx 101 101 1111 | |
| 0011010111111111 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # 9.1.1.11 SUB (immediate) : SUB 8-bit immediate | |
| # SUBS Rdn, Rdn, #Imm8 | |
| # SUBS R5, 01111111 | |
| # 001 11 Rd Imm8 | |
| # 001 11 101 01111111 | |
| 0011110101111111 1 1 1 xxxxx 00000000000000000000000001111111 0110 xxx 101 101 1111 | |
| 0011110101111111 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # SUBS R5, 01111111 | |
| # 001 11 101 11111111 | |
| 0011110111111111 1 1 1 xxxxx 00000000000000000000000011111111 0110 xxx 101 101 1111 | |
| 0011110111111111 0 0 0 00000 00000000000000000000000000000000 0000 000 000 000 0000 | |
| # instruction e c i Imm5 Imm32 Alu_ Rm Rn Rd flag |
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| Instruction[16] Enable[1] Stack_Pointer[32] Write_Enable[1] New_Stack_Pointer[32] | |
| 1111111111111111 0 11111111111111111111111111111111 0 00000000000000000000000000000000 | |
| # Instruction Enable Stack_Pointer Write_Enable New_Stack_Pointer | |
| # ADD | |
| 1011000000000000 1 00000000000000000000000000000000 1 00000000000000000000000000000000 | |
| 1011000000000001 1 00000000000000000000000000000001 1 00000000000000000000000000000010 | |
| 1011000001111111 1 00000000000000000000000000000000 1 00000000000000000000000001111111 | |
| 1011000000000000 0 00000000000000000000000000000000 0 00000000000000000000000000000000 | |
| 1011000000000001 0 00000000000000000000000000000001 0 00000000000000000000000000000000 | |
| 1011000001111111 0 00000000000000000000000000000000 0 00000000000000000000000000000000 | |
| #SUB | |
| 1011000010000000 1 00000000000000000000000000000000 1 00000000000000000000000000000000 | |
| 1011000010000001 1 00000000000000000000000000000010 1 00000000000000000000000000000001 | |
| 1011000010000001 1 00000000000000000000000000000000 1 11111111111111111111111111111111 | |
| 1011000010000000 0 00000000000000000000000000000000 0 00000000000000000000000000000000 | |
| 1011000010000001 0 00000000000000000000000000000010 0 00000000000000000000000000000000 | |
| 1011000010000001 0 00000000000000000000000000000000 0 00000000000000000000000000000000 |
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